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PCIE-5565型反射內(nèi)存卡

詳細(xì)說明

光纖反射內(nèi)存網(wǎng)絡(luò)硬件延時(shí)測(cè)試報(bào)告結(jié)論摘要

1）數(shù)據(jù)包在整個(gè)環(huán)網(wǎng)上的延時(shí)

網(wǎng)絡(luò)數(shù)據(jù)從開始發(fā)送到在環(huán)網(wǎng)流轉(zhuǎn)一周的總延時(shí)為：總延時(shí)≈600*（節(jié)點(diǎn)數(shù)-1）+3*光纖線長(zhǎng),單位：ns。

2）通過PCI總線進(jìn)行板卡反射內(nèi)存讀寫的延時(shí)

PCI總線在寫時(shí)，需要準(zhǔn)備時(shí)間為5CLK約0.125us，之后每讀取4Bytes個(gè)數(shù)據(jù)需要3個(gè)CLK約0.075us。因此，PCI寫入N個(gè)數(shù)據(jù)的延時(shí)可表示為：0.125us+ (N％4 + 1) *0.075us

六、應(yīng)用舉例：基于光纖反射內(nèi)存網(wǎng)實(shí)現(xiàn)遠(yuǎn)程多試驗(yàn)室協(xié)同試驗(yàn)

隨著戰(zhàn)場(chǎng)環(huán)境復(fù)雜度的提高，半實(shí)物仿真實(shí)驗(yàn)面臨更嚴(yán)峻的挑戰(zhàn)。由于試驗(yàn)場(chǎng)地面積有限，各大型仿真非標(biāo)設(shè)備常分布于不同樓宇的試驗(yàn)室內(nèi)，完成仿真試驗(yàn)需要多樓宇、多試驗(yàn)室跨域聯(lián)合進(jìn)行。同時(shí)，面臨試驗(yàn)資源緊的問題，需要多項(xiàng)試驗(yàn)并行進(jìn)行。這對(duì)多試驗(yàn)室遠(yuǎn)程互連及并行試驗(yàn)提出了迫切的需求，而遠(yuǎn)程協(xié)同仿真技術(shù)中的數(shù)據(jù)實(shí)時(shí)交互技術(shù)是解決上述問題的關(guān)鍵。本文采用基于光纖HUB的實(shí)時(shí)光纖反射內(nèi)存網(wǎng)絡(luò)搭建系統(tǒng)硬件平臺(tái)，實(shí)現(xiàn)多試驗(yàn)室協(xié)同試驗(yàn)仿真。

在多試驗(yàn)任務(wù)并舉的情況下，綜合考慮不同試驗(yàn)室聯(lián)合仿真的需要，兼顧數(shù)據(jù)通訊的安全性和線纜連接的方便性，本節(jié)以三個(gè)實(shí)驗(yàn)室協(xié)同仿真為例，采用實(shí)時(shí)光纖反射內(nèi)存、HY-FHX8型光纖HUB搭建網(wǎng)絡(luò)，通過試驗(yàn)綜合控制系統(tǒng)實(shí)現(xiàn)光纖網(wǎng)絡(luò)的集中管理，設(shè)計(jì)方案如下圖所示。